12
FN9186.3
January 3, 2006
IC Operation State Diagram
Soft Start
(Tss)
Reset &
Latch
Off
State
FLT
Asserted
Current
Limit
Mode
Run
OC Timer
(Toc)
Output
Voltage
Available
PG
Asserted
Gate
Pulldown
No
Power
PG
&
FLT
Outputs
Valid
FLT
Cleared
Apply Power
Bias>1V
Bias>2V
EN Asserted
EN De-asserted
RTR/LTCH = L
RTR/LTCH = H
Io>ICR
(WOC)
Count 64
Pulses
&
Reset
Vuv>645mV
Vuv<633mV
Io>ICR
Io>>ICR
Io>=Icr
AND
t>Toc
FIGURE 16.
ISL6173
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